2年以上
碩士
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職位描述
該職位信息待核驗，請仔細(xì)了解后再進(jìn)行投遞！
工作職責(zé)
1.負(fù)責(zé)產(chǎn)品研發(fā)中FPGA方案設(shè)計、代碼實現(xiàn)、仿真測試、文檔編寫等相關(guān)工作。
崗位要求
1.碩士研究生及以上學(xué)歷；
2.電子類、通信類、自動化類、計算機類相關(guān)專業(yè)；
3.從事FPGA軟件開發(fā)兩年及以上，有從事ZYNQ相關(guān)開發(fā)經(jīng)驗、熟悉通信算法實現(xiàn)的人員優(yōu)先；
4.精通ISE、VIVADO等相關(guān)邏輯開發(fā)信息，熟練掌握Verilog HDL,具有良好的編碼風(fēng)格；精通時序仿真、功能仿真，熟練使用modelsim仿真工具；熟練掌握數(shù)字電路基礎(chǔ)，會使用電子設(shè)備測試儀器；
5.積極主動,抗壓能力強,具有較強的責(zé)任心與學(xué)習(xí)能力,具備良好的技術(shù)鉆研精神和團隊協(xié)作精神,認(rèn)同軍工行業(yè)企業(yè)文化。
1.負(fù)責(zé)產(chǎn)品研發(fā)中FPGA方案設(shè)計、代碼實現(xiàn)、仿真測試、文檔編寫等相關(guān)工作。
崗位要求
1.碩士研究生及以上學(xué)歷；
2.電子類、通信類、自動化類、計算機類相關(guān)專業(yè)；
3.從事FPGA軟件開發(fā)兩年及以上，有從事ZYNQ相關(guān)開發(fā)經(jīng)驗、熟悉通信算法實現(xiàn)的人員優(yōu)先；
4.精通ISE、VIVADO等相關(guān)邏輯開發(fā)信息，熟練掌握Verilog HDL,具有良好的編碼風(fēng)格；精通時序仿真、功能仿真，熟練使用modelsim仿真工具；熟練掌握數(shù)字電路基礎(chǔ)，會使用電子設(shè)備測試儀器；
5.積極主動,抗壓能力強,具有較強的責(zé)任心與學(xué)習(xí)能力,具備良好的技術(shù)鉆研精神和團隊協(xié)作精神,認(rèn)同軍工行業(yè)企業(yè)文化。
注：聯(lián)系我時，請說是在江蘇人才網(wǎng)上看到的。
工作地點
地址：成都金牛區(qū)金牛區(qū)盛業(yè)路66號
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職位發(fā)布者
呂聰凡HR
成都天奧電子股份有限公司
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電子技術(shù)·半導(dǎo)體·集成電路
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500-999人
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國有企業(yè)
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高新西區(qū)新業(yè)路88號
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